基本的SRAM的架构如图1所示，SRAM一般可分为五大部分：存储单元阵列（core cellsarray），行/列地址译码器(decode），灵敏放大器(Sense Amplifier），控制电路（controlcircuit），缓冲/驱动电路（FFIO）。SRAM是静态存储方式，以双稳态电路作为存储单元，SRAM不像DRAM一样需要不断刷新，而且工作速度较快，但由于存储单元器件较多，集成度不太高，功耗也较大。
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